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// :warning-caption: Warnung
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= Selected Topics in Electronics Engineering and Computer Sciences =
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= Selected Topics in Embedded Systems =
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In diesem Wiki finden Sie Information zum Einstieg in das erste Semester unseres link:http://embsys.technikum-wien.at/academics/master.php[Master-Studiums _Embedded Systems_], insbesondere zur LV _Ausgewählte Kapitel_ (Selected Topics in Electronics Engineering and Computer Sciences).
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In diesem Wiki finden Sie Information zum Einstieg in das erste Semester unseres link:http://embsys.technikum-wien.at/academics/master.php[Master-Studiums _Embedded Systems_], insbesondere zur LV _Ausgewählte Kapitel_ (Selected Topics in Embedded Systems).
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... | ... | @@ -53,9 +53,10 @@ Im Rahmen dieser Lehrveranstaltung werden u.a. folgende Themen behandelt: |
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=== Electronic Basics ===
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[[e-warmup]]
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Grundkenntnisse im Bereich Elektronik und Analogem Schaltungsdesign sind Zugangsvoraussetzungen für die Aufnahme in den Masterstudiengang Embedded Systems. Um die wichtigsten Grundlagen zu wiederholen und gegebenenfalls Wissenslücken zu füllen, werde Unterlagen und Übungsbeispiele für das Selbststudium angeboten.
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Um Grundkenntnisse im Bereich Elektronik und analogem Schaltungsdesign zu wiederholen und gegebenenfalls Wissenslücken zu füllen, werden Unterlagen und Übungsbeispiele für das Selbststudium angeboten.
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Eine etwaige Beurteilung erfolgt auf Grund von individuell ausgearbeiteten Beispielen.
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Darin werden die folgende Themen behandelt:
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Folgende Themen werden behandelt:
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* AC/DC Grundlagen
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* Passive Bauelemente
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... | ... | @@ -66,24 +67,25 @@ Darin werden die folgende Themen behandelt: |
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== Andere Ausgewählte Kapitel ==
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Jeder Studierende muss ausreichend viele Module aus untenstehender Tabelle wählen, um mindestens 6 ECTS-Punkte zu erreichen.
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Der Zeitplan (link:https://cis.technikum-wien.at/documents/mes/1/sec/semesterplan/schedule.pdf[CIS-Zugang erforderlich]) erlaubt eine kollisionsfreie Kombination aller Module, welche sich über fast das gesamte 1. Semester verteilen.
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Jeder Studierende muss zu Semesterbeginn Module in einem Ausmaß von mindestens 6 ECTS-Punkte aus untenstehender Tabelle wählen, die im 1. Semester zu absolvieren sind.
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Der Zeitplan erlaubt eine kollisionsfreie Kombination aller Module, welche sich über fast das gesamte 1. Semester verteilen.
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Sollten Sie auf Grund Ihrer Vorkenntnisse einzelne Fächer verpflichtend absolvieren müssen, ist dies in vorläufigen Zuordnung ersichtlich (link:https://cis.technikum-wien.at/documents/mes/1/sec/semesterplan/preallocation.pdf[siehe hier]).
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// Please enter your names on the list on the pinboard near the program's office until Wed, Sep. 9th.
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Sollten Sie auf Grund Ihrer Vorkenntnisse einzelne Fächer verpflichtend absolvieren müssen, wird Ihnen dies u.a. im Aufnahmegespräch kommuniziert.
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Die Gesamtnote für diesen Kurs setzt sich aus den nach ECTS gewichteten Noten der einzelnen Module zusammen, wobei jedes ausgewählte Einzelmodul positiv absolviert werden muss.
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.Module zur Auswahl
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[format="psv", width="66%", options="header",frame="all",cols="^1,3,^1,^1,2,3"]
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[format="psv", width="66%", options="header",frame="all",cols="^1,3,^1,^1,2"]
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| Modul# | Titel | ECTS | Termine | Lektor | Webseite
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| 1 | <<e-warmup,Electronic Basics>> | 2 | 4 | Dominik Widhalm | link:https://cis.technikum-wien.at/documents/mes/1/sec/semesterplan/em1/[CIS Link]
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| 2 | <<c-warmup,C Warm-Up>> | 2 | 4 | Stefan Tauner | link:https://cis.technikum-wien.at/documents/mes/1/sec/semesterplan/em2/[CIS Link]
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| 3 | <<sysprog,Linux System Programming>> | 3 | 6 | Stefan Tauner | link:https://cis.technikum-wien.at/documents/mes/1/sec/semesterplan/em3/[CIS Link]
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| 4 | <<java-intro,Java Intro>> | 2 | 4 | Martin Deinhofer | link:https://cis.technikum-wien.at/documents/mes/1/sec/semesterplan/em4/[CIS Link]
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| 5 | <<java-embedded,Java for Embedded>> | 2 | 4 | Martin Deinhofer | link:https://cis.technikum-wien.at/documents/mes/1/sec/semesterplan/em5/[CIS Link]
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| 6 | <<matlab,Matlab/Simulink>> | 2 | 4 | Harald Schuster | link:https://cis.technikum-wien.at/documents/mes/1/sec/semesterplan/em6/[CIS Link]
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| 7 | <<vhdl-primer,VHDL Primer>> | 3 | 6 | Andreas Puhm | link:https://cis.technikum-wien.at/documents/mes/1/sec/semesterplan/em7/[CIS Link]
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| 8 | <<fpga-project,FPGA Project>> | 3 | 6 | Andreas Puhm | link:https://cis.technikum-wien.at/documents/mes/1/sec/semesterplan/em8/[CIS Link]
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| Modul# | Titel | ECTS | Termine | Lektor
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| 1 | <<e-warmup,Electronic Basics>> | 2 | 4 | Dominik Widhalm
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| 2 | <<c-warmup,C Warm-Up>> | 2 | 4 | Stefan Tauner
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| 3 | <<sysprog,Linux System Programming>> | 3 | 6 | Stefan Tauner
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| 4 | <<java-intro,Java Intro>> | 2 | 4 | Martin Deinhofer
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| 5 | <<java-embedded,Java for Embedded>> | 2 | 4 | Martin Deinhofer
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| 6 | <<matlab,Matlab/Simulink>> | 2 | 4 | Harald Schuster
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| 7 | <<vhdl-primer,VHDL Primer>> | 3 | 6 | Andreas Puhm
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| 8 | <<fpga-project,FPGA Project>> | 3 | 6 | Andreas Puhm
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FIXME
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=== Benotung ===
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Die Gesamtnote für diesen Kurs setzt sich aus den nach ECTS gewichteten Noten der einzelnen Module zusammen, wobei jedes ausgewählte Einzelmodul positiv (d.h. mit mindestens 50%) absolviert werden muss.
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.*Notenschlüssel*
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// * Prozentpunkte | Note
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* Sehr Gut: 88-100%
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* Gut: 75-87%
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* Befriedigend: 63-74%
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* Genügend: 50-62%
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* Nicht Genügend: 0-49%
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Die Gesamtnoten finden Sie zu gegebener Zeit link:https://cis.technikum-wien.at/documents/mes/1/sec/semesterplan/grades.pdf[hier] (CIS-Zugang erforderlich). |